更新時間：2024-07-01
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孕龍邏輯分析儀 LAP-C322000介紹：
孕龍邏輯分析儀 LAP-C322000?支持I²C、SPI、USB2.0、RS232、CAN、LIN、FlexRay、MIL-STD 1553、I²S常用的幾個總線協議，還支持MVB、WTB、GPIB、PCI、USB 1.1、USB 2.0、HDMI、I2S、S/PDIF、BMS、ModBus等110種總線協議而且全部免費！！！！！！
【 產品規格 】 | |
| 取樣頻率 | 內部(時序)(異步) 100Hz~200MHz 外部(狀態)(同步) 100MHz |
| 待測信號 | 頻寬 75MHz 觸發電壓范圍 -6V~+6V 觸發電壓分辨率 ±0.1V |
| 內存 | 內存容量 64Mbits 每信道內存深度 2Mbits (Max 512Mbits for compression) |
| 觸發 | 觸發方式 Pattern/Edge 觸發通道 32 CH 延后觸發 YES 觸發階層 1 Level 觸發計數 1~65535 |
| 軟件功能 | 波形數據壓縮 Max 2M bits x 256, 可用通道24CH 時基范圍 波形垂直縮放比例 操作接口 波形觸發分頁大值 波形寬度顯示 波形濾波及延遲 波形觸發延遲 可增加定位棒 定位棒自動貼進功能 軟件自動升級 可選擇分析數據的范圍 資料統計 自動存檔 波形濾波分隔棒 總線分析 數據比對 總線Latch功能 總線封包列表功能 封包列表匯出功能 ＊總線協議觸發: 串行 / 并行 ＊脈波寬度觸發模組 |
| 電源 | 電源USB (DC 5V, 500mA) 靜態消耗功率 1W 瞬間大消耗功率 2W |
| 其它 | 系統支持 Windows 2000 / XP (32bits)/ Vista / Win 7 相位誤差 < 1.5ns 大輸入電壓 ±30V 輸入阻抗 500KΩ/10pF 安規認證 FCC / CE / WEEE / RoHS /REACH |
| 堆棧功能 | 支持 Channel mode: LAP-C(322000) + LAP-C(322000) => Channel = 62CH, Memory = 2Mbits Memory mode: LAP-C(32128) + LAP-C(32128) => Channel = 31CH, Memory = 256Kbits |
| Double模式 | 支持 通道: 16通道 內存容量: 4M |
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物品清單
主機，測試線，測試勾，USB線，軟件/說明書光盤，保修卡，攜帶包各壹套。
 | 具有外部按鈕執行邏輯分析儀取樣功能 |
| 在孕龍邏輯分析儀的硬件上，有一個START的按鈕，當邏輯分析儀軟件在開啟的狀態，可利用此按鈕來讓邏輯分析儀執行取樣的動作。此按鈕能讓您更快速的操作邏輯分析儀取得被測物的資料。 |
| 壓縮技術 |
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| 孕龍科技推出波行壓縮zhuan利技術，可以在不增加內存的狀況下獲取更長的波形資料。For Example：設定內存深度為1M，取樣率為50MHz。未開啟壓縮功能時僅可擷取20.972ms，若開啟壓縮功能后，以同樣記憶深度為1M，取樣率為50MHz進行取樣，則可以將波形時間增加至3.999s，大大的提升了擷取數據量。 | |||
| 信號濾波延遲 |
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| 孕龍科技推出了信號濾波延遲zhuan利技術，信號濾波功能可以將訊號進行條件式的擷取，如下圖所述，將A1通道設定濾波條件為高準位，透過上下并列窗口的比較可明顯看出兩者間的差異，而信號濾波延遲則是能夠將信號濾波的條件更加靈活化，使用者可自行設定過濾的時間狀態。 For Example：客戶端有一組DUT出現Bug，Bug的內容是當程序讀取的時候可能會出現讀取錯誤的情況，此時就可以利用信號濾波延遲進行條件式的擷取，藉此進行Bug分析 （讀取狀態為0X5A、讀取命令周期為10us）透過信號濾波延遲功能，邏輯分析儀就可以只針對當0X5A的數值出現后僅擷取命令時間10us，進而分析Bug的發生問題。 | |||
| 觸發分頁技術 |
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| 孕龍邏輯分析儀加入了觸發分頁(Trigger Page)的zhuan利技術，Trigger Page簡單的說就是將連續又漫長的訊號數據分頁。 以目前所設定的內存長度為一頁，觸發點的所在即為*頁，分析完*頁的數據后，只要被測物的數據每一次都是相同的，且觸發狀態設定不變，就可以將Trigger Page設為2再重新啟動邏輯分析儀，待邏輯分析儀停止擷取數據且完成顯示時，波形顯示區內的內容即為第二頁的數據，第二頁的數據就是緊接著*頁結束后的數據。 For Example：設定記憶深度為32K、取樣率為200MHz，設定觸發分頁為1，所擷取訊號的結束點為147.465us，而數據為0X47的前半段，再以相同記憶深度與取樣率進行擷取，設定觸發分頁為2時，所擷取訊號開始點為觸發分頁1時的結束點147.465us，此時可看見資料0X47的后半段。 | |||
| 觸發次數計算 |
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| 孕龍邏輯分析儀加入了觸發次數計算（Trigger Counter）的技術，Trigger Counter，的功能是將有一個以上符合觸發值的被測信號，使用者可決定觸發點是要在第幾個符合觸發設定的位置進行觸發， *次碰到觸發的設定狀態時就觸發Trigger Counter就要設定為1（預設），第三次碰到觸發的設定狀態時才觸發Trigger Counter就要設定為3，依此類推。 | |||
| 內存分析 |
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| 孕龍邏輯分析儀加入了內存分析功能(Memory Analyzer)，針對總線中有使用ADDRESS的類別，如IIC、HDQ、3-WIRE、PM、SM、IIC(EEPROM 24LX)…等等，能夠將總線中的ADDRESS、READ/WRITE、DATA狀態記錄于內存分析表中，讓使用者進行總線分析時也能夠針對ADDRESS、READ/WRITE、DATA加以記錄分析。 | |||
| 總線協議分析實例 – IIS總線協議分析譯碼 |
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| 孕龍科技的I2S總線分析模塊，可幫助使用者進行I2S總線分析，透過譯碼模塊可將訊號中的Data-L及Data-R數值直接顯示于屏幕上，孕龍科技IIS總線分析模塊可依照待測I2S訊號格式讓使用者選擇Data bit長度為16、20、24、32 bits，方便使用者面對各種不同的I2S訊號均能順利分析。 | |||
| IIS總線實際量測–步驟一 |
| 將測試線連接至邏輯分析儀訊號連接座上，將測試線另外一端連接至待測物上，依照待測物狀況不同，也可以使用配件內的測試鉤來連接待測物。 |
| 步驟二 |
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| 依照快速安裝手冊第三章所述，進行邏輯分析儀設定，設定完成后啟動邏輯分析儀軟件及送出待測物訊號進行擷取，擷取完成如圖所示。 提示：邏輯分析儀取樣率需高過待測目標頻率四倍以上才能確保訊號正確。 |
| 步驟三 |
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| 將訊號歸納成總線，按住鍵盤上的CTRL鍵不放，在信道列表上以鼠標點選要歸納的訊號信道使其反白，選擇完畢后點下鼠標右鍵選擇歸納信號為總線選項，此時信道列表內會增加一組所設定的總線。 提示：進行總線分析時，需依照待測Protocol信道數來設定總線信道數，如IIC便設定兩個通道，UART設定一個通道。 |
| 步驟四 |
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| 在新增的總線上點選鼠標右鍵，選擇總線屬性，再選擇要使用的總線分析模塊。 提示：每一種總線分析模塊均有相對應的參數設定，使用者可在參數設定中依照待測總線內容加以設定。 |
| 步驟五 |
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| 完成設定后，軟件模塊會將總線內的封包數值顯示于屏幕上。 提示：孕龍科技邏輯分析儀軟件還有其它強大功能可幫助使用者進行總線分析，如封包列表顯示、數據搜尋、脈波寬度搜尋….等等。 |
